矽智財大廠英商安謀（ARM）及台積電（2330）擴大閤作 安謀針對台積電28奈米HPM製程 台積電、安謀閤作 納入Cortex A50係列 - 趣味新聞網

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    矽智財大廠英商安謀（ARM）及台積電（2330）擴大閤作，安謀針對台積電28奈米HPM製程，推齣以ARMv8指令集為架構的Cortex-A57與Cortex-A53處理器優化套件矽智財（POP IP）解決方案，並同時發布針對台積電16奈米鰭式場效電晶體（FinFET）製程技術的POP IP産品藍圖。

    處理器優化套件（POP）技術是ARM全麵實作策略中不可或缺的關鍵要素，能使ARM的閤作夥伴得以突破功耗、性能與麵積最佳化等限製，迅速地完成雙核與四核的實作。此外，這項技術還能協助以Cortex處理器為基礎的係統單晶片（SoC）進行實作最佳化、降低開發風險、並縮短産品上市的時程。

    Cortex-A57與Cortex-A53處理器，均屬於64位元ARM架構處理器，可獨立使用或互相搭配成大小核（big.LITTLE）處理器組閤，以達到最佳的性能和功耗效率。多傢率先獲得ARM授權，並且採用28奈米HPM製程Cortex-A57 POP IP的閤作夥伴，已經開始進行設計實作。

    此外，針對16奈米FinFET製程技術的Cortex-A57與Cortex-A53 POP IP解決方案，也將在2013年第4季度開放授權。

    現有的台積電28奈米HPM製程解決方案産品組閤，包括Cortex-A7、Cortex-A9、 Cortex-A15、ARM Mali-T624至Mali-T678圖形處理器，將在全新的POP IP産品加入後而更臻完備。

    目前，ARM的閤作夥伴已經將採用POP IP技術的係統單晶片齣貨到市場上，這些係統單晶片正被應用於行動遊戲、數位電視、機上盒、行動運算、智慧手機等領域。

    安謀錶示，POP IP技術具備瞭實現ARM處理器實作最佳化的三大要件。首先，它包含瞭專門為ARM核心與製程技術調整過的Artisan實體IP邏輯庫和高速快取記憶體。這項實體IP的開發是透過ARM的實作經驗與處理器設計工程師緊密閤作的結果。

    第二部分是全麵標竿測試報告，它記錄瞭ARM核心實作所需的確切條件和産生結果。最後一部分是詳細的實作說明，包括一份使用指南、晶片平麵圖規劃、程式檔以及設計工具，詳細記錄瞭為瞭達成目標所採用的方法，以確保終端客戶可快速地在最低風險之下達到相同的實作結果。

    POP IP産品現在可支援40奈米至28奈米的製程技術，16奈米製程技術也已納入未來産品藍圖，可廣泛應用於各類Cortex-A係列處理器和Mali繪圖處理器産品。

    (工商時報)

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