發表日期 4/1/2022, 2:39:20 PM
新智元報道
作者:馬愷聲
編輯:好睏
【新智元導讀】Chiplet最近可謂是風口正勁,但是芯片行業並不是簡簡單單比拼誰能做齣來就可以的。
Chiplet需要通過大規模量産催動行業更新,同時還要考慮産品良率、封裝良率、各種成本等等。
在這個前提下,隻有摺算下來的好處能夠明顯超過傳統soc方案,纔能夠被非常好的推廣。
今天,我們就專門來算算錢。
文中數據皆真實可考,一部分獲取於2021年作者自己的芯片加工與封裝等,一部分藉助於Chiplet産業聯盟所獲取。
多芯片集成技術
多芯片集成技術被業界廣泛認為是摩爾定律的延續,節省成本是其廣為人知的優勢之一,但是很少有工作能夠定量地展示多芯片集成係統對比單芯片的成本優勢。
我們基於三種典型的多芯片2.5D集成技術,建立瞭一個定量的多芯片係統成本模型,並提齣瞭一套分析方法,從良品率提高、芯片和封裝復用以及異構集成等多方麵分析瞭多芯片係統的成本效益。
文章被Design Automation Conference(DAC)2022錄用。清華交叉院博士研究生馮寅瀟是該論文的第一作者,清華大學交叉院助理教授馬愷聲是該論文的通訊作者。
論文鏈接:https://doi.org/10.48550/arXiv.2203.12268
與傳統的單芯片係統相比,多芯片集成係統的成本計算變得更加復雜,如果不經過認真評估,盲目采用多芯片架構反而會導緻更高的成本。
因此,我們建立一個名叫「Chiplet精算師」的成本模型,利用此模型對多芯片集成係統的成本效益進行瞭精緻的評估,並迴答瞭架構設計者所麵臨的諸多難題:
該采用何種封裝集成方案?
該把整個係統拆成多少小芯片?
是否應該在多個係統間復用封裝?
如何復用芯片?
如何發揮異構集成的優勢?
成本模型
1. 不是所有的芯片在經濟上都適閤用Chiplet技術。
這張圖中的9個柱狀圖,都是RE Cost(recurring engineering cost,可以理解成不考慮一次性投入,生産一片芯片的錢),橫嚮是14nm,7nm,5nm,縱嚮是幾個Chiplets封裝到一起。
我們再看一個詳細的圖,是上圖中7nm,5個Chiplets拼一起放大版。圖的橫軸是麵積,縱軸是單位麵積成本。四種封裝方式為:SoC,MCM封裝,InFO,2.5D封裝。
可以看到,如果在200平方毫米以下,沒有必要做Chiplet。真正有收益的時候在800平方毫米以上的大芯片。這也是為什麼今天超大的芯片用Chiplet方案,因為經濟上確實是更閤適的。
另外,伴隨先進封裝而來的大量測試、封裝成本,極其先進的封裝都非常昂貴,甚至數倍於矽的成本,首要解決的是能不能做大芯片的問題。未來隨著封裝價格的下降,Chiplet路綫會越來越有收益。
MCM和InFO成本相對更低,更劃算,預計基於先進封裝裏麵的基礎封裝的芯片會更早起量。
2. 多芯片集成在越先進工藝下(如5nm)越具有顯著的優勢,因為在800mm2麵積的單片係統中,矽片缺陷導緻的額外成本占總製造成本的50%以上。
對於成熟工藝(14nm),盡管産量的提高也節省瞭高達35%的成本,但由於D2D接口和封裝開銷(MCM:>25%,2.5D:>50%),多芯片的成本優勢減弱。
3. 雖然製造成本是需要考慮的主要成本,但一次性投入的成本往往是決定性的,特彆是對於沒有巨大産量保障的産品。
對於單個係統,我們發現,單獨做每個小芯片,都存在很高的一次性投入成本,如流片時掩膜闆的成本,因此多芯片架構導緻總的一次性投入成本非常高(50萬産量時占到總成本的36%)。對於5nm係統,當産量達到2韆萬時,多芯片架構開始帶來迴報。
也就是說,如果單一企業想要靠著自研全部的小芯片來搭建芯片,並且隻有一款芯片的話,並不劃算。但是確實能帶來比如高中低檔次芯片的搭配等優勢。
當然,這裏麵一次性投入成本可以伴隨著小芯片的復用,得到巨大的收益。
模型復用
通過許多探究實驗發現,多芯片架構的成本優勢需要通過充分利用復用和異構來實現。把常見的多芯片復用架構分為三類:單芯片多係統(SCMS)、一中心多拓展(OCME)和固定插座多組閤(FSMC)。
1. 對於SCMS架構,由於芯片復用,與單芯片係統相比,芯片大量節省瞭一次性投入成本。
該復用方案的最大優點是隻需要一個芯片,因此無需製造多個芯片可立即生效,這種架構適用於同一産品綫不同等級的産品。(鏡像Die在設計製造過程成本在這裏被當做單個Die來考慮,影響方案,不影響成本核算。謝謝夏晶指齣)
2. OCME架構相比SCMC,使得異構工藝成為可能。
如果把多個係統共用的對先進工藝不敏感的模塊坐在落後工藝的中心矽片上,可以帶來巨大的收益,許多包含瞭DDR、PCIe等模塊的係統都可以采用此架構。
數據中的Pkg-reused的概念是封裝復用,比如一個基闆上可以放4個,實際上隻放瞭2個Die,另外兩個Die用Dummy Die填充以解決散熱和應力問題。那這樣封裝看起來並不是最大化利用的,但是總體來看,反而更加劃算瞭。
3. 對於FSMC架構,則是把復用可能性最大化瞭。
復用的芯片越多,一次性投入成本攤銷的收益就越大。當可復用性得到充分利用時,均攤後的先期投入就會小到可以忽略。在這一點上,多芯片架構的巨大成本節約潛力便顯現齣來。
成本優勢不僅體現在製造成本的節約上,也體現在一次性投入成本的節約上。看得齣來,到瞭最後,誰的手裏有更多的Die,或者說誰的方案能兼容更多的Die,誰就能更多節省成本。
圖中k是Package上麵有多少個Slot,n是手裏有多少種不同的Die
多芯片架構是大勢所趨
當然瞭,多芯片架構的優勢不是無條件的,而是取決於許多復雜的因素。
為瞭幫助芯片架構師在多芯片架構上做齣更好的決策,我們建立瞭一個定量模型來比較不同方案的成本。
模型允許設計師在早期階段驗證成本。我們還展示瞭多芯片體係結構如何從良率提高、芯片和封裝復用以及異構性中獲益:
當矽片缺陷的成本超過封裝導緻的成本時,多芯片架構開始帶來迴報。
係統越接近摩爾極限(最先進工藝,最大麵積),多芯片架構的成本效益就越高。
更小的芯片粒度帶來的成本效益具有邊際效應,所以,把單獨一個IP做成一個Die是不劃算的。
是否復用封裝取決於製造成本和均攤的一次性投入成本哪個占主導地位。量小的時候,要盡量的復用封裝;量多的時候,可以單獨再次開發先進封裝。這個平衡點大約在80-100萬顆每年。
對於檔次分明的同質係統,SCMS方案具有顯著的成本優勢;對於共享大麵積HUB模塊的係統,采用OCME方案更具成本效益;FSMC方案提供瞭最大的復用可能性,但是對Die的形狀,以及四邊的接口數量要求很高。
基本原則是用更少的芯片構建更多的係統,芯片復用的成本效益對於破碎化、層次化的需求更為明顯。
站在今天的角度看:先進封裝,並不是越先進越好,價格過高,數倍於矽的成本,決定瞭其不會大範圍量産使用;反而是,基本版本的先進封裝在性能上基本上可以滿足架構訴求,可能會最先被大範圍使用。提高良率、降低成本是國內封裝廠的要務(尤其是在基闆生産方麵)。從未來的角度看,據我們所知,國內有接近十傢基闆廠商在建設,數傢先進封裝廠在建設,按照兩年建廠,兩年良率爬坡的發展節奏,未來三四年後,先進封裝良率和成本將迎來大幅優化。到時候,Chiplet技術應用將迎來規模性爆發。
機會仍在,國內同仁仍需努力!
模型細節
Chiplet精算師引入瞭模塊、芯片和封裝三個概念,任何一個係統都可以由這三個層次構成。
其中,每個Chiplet對應一個模塊,D2D接口作為一個特殊的模塊在多個Chiplet間復用,可以用數學語言錶達為:
芯片的製造成本可以大緻分為:(1)矽片成本,(2)矽片缺陷導緻的損失,(3)封裝成本,(4)封裝缺陷導緻的損失,以及(5)封裝缺陷所導緻好矽片的浪費。
(1)(2)兩項在前人的工作中已經被充分討論,與多芯片集成和先進封裝相關的(3)(4)(5)成本可以錶達為:
其中,y1是中間插入層製造的良率,y2是芯片與插入層鍵閤的良率,y3是中間插入層與基闆鍵閤和良率。與此同時,chip-first與chip-last兩種不同的封裝工藝流程也被考慮在內:
一次性投入成本(NRE,包括軟件與IP授權、係統設計驗證以及流片費用等)占據瞭總成本的一大部分。我們從麵積入手,在成本模型中引入瞭一次性投入成本。對於任何一個芯片,其一次性投入成本可以估計為:
其中Sc是芯片的麵積,Sm是模塊的麵積,C是與麵積無關的固定投入。由此可以得到如果要設計若乾套係統,如果均采用單芯片架構,總的一次性投入成本可以估計為:
而如果采用多芯片架構,總的一次性投入成本可以估計為:
其中,Sp是封裝麵積,Cp是封裝的固定投入,CD2D是開發D2D接口的投入。
KmSm:與模塊麵積相關的NRE成本,包括模塊前端設計、模塊前端驗證等。
KcSc:與芯片麵積相關的NRE成本,包括架構設計、係統驗證、後端設計、後端驗證等。
C:與芯片和模塊麵積無關的NRE成本,包括軟件授權、IP授權、流片(芯片試製的掩膜費用)等。
KpSp:與封裝麵積相關的NRE成本,包括封裝設計等。
Cp:與封裝麵積無關的NRE成本,包括封裝製造開模等成本。
其他開銷,比如設備費、場地費、日常維護費用視情況包含於C或KcSc。
這個成本模型在AMD的多芯片架構上進行瞭驗證,在矽片成本上,取得瞭與AMD公開數據基本一緻的結果。
區彆在於AMD沒有算入先進封裝集成多塊芯片的額外成本。
作者介紹
馬愷聲:清華大學交叉信息研究院教研係列助理教授。
他在賓夕法尼亞州立大學計算機科學與工程係獲得博士學位。研究重點是計算機結構、計算機視覺相關人工智能算法設計,重點是可解釋、穩健性和緊湊模型設計。
他在CVPR、NeurIPS等AI會議,DAC、ISCA等計算機體係結構會議發錶文章。並曾獲得過諸多奬項,包括2015年HPCA最佳論文奬,2016年IEEE MICRO Top Picks,2017年ASP-DAC最佳論文奬。2018年EDAA最佳博士論文奬。
此外,他還獲得瞭2016年賓夕法尼亞州立大學CSE係最佳研究生研究奬,2016年NSF ASSIST工程研究中心通訊封麵特寫,2011年楊芙清-王陽元院士奬學金。
馮寅瀟,清華大學在讀博士生。
他是清華大學交叉信息研究院的在讀博士生(博士二年級),導師為馬愷聲。
他本科畢業於上海交通大學,獲信息工程(人工智能方嚮)和數學與應用數學雙學位。同時,他也是上海交通大學緻遠工程榮譽項目的成員。
本科期間,他獲得瞭許多與眾不同的奬項和榮譽,包括國傢奬學金。他在材料、器件、電路、算法和硬件方麵具有混閤背景和經驗。他甚至有無塵室製造的經驗。
參考資料:
https://doi.org/10.48550/arXiv.2203.12268